2.4. Процессор Cortex
2.4.1. Шины
Процессор Cortex-M3 выполнен по Гарвардской архитектуре, которая подразумевает использование раздельных шин данных и инструкций. Они называются шиной Dcode и Icode, соответственно. Обе эти шины могут осуществлять доступ к инструкциям и данным в диапазоне адресов 0x00000000 - 0x1FFFFFFF. Также имеется дополнительная системная шина, которая предоставляет доступ к области системного управления по адресам 0x20000000-0xDFFFFFFF и 0xE0100000-0xFFFFFFFF. У встроенной отладочной системы процессора Cortex имеется еще одна дополнительная шинная структура, которая называется локальной шиной УВВ (Private Peripheral Bus, PPB).
